English
全部
搜索
图片
视频
地图
资讯
更多
购物
航班
旅游
笔记本
报告不当内容
请选择下列任一选项。
无关
低俗内容
成人
儿童性侵犯
时长
全部
短(小于 5 分钟)
中(5-20 分钟)
长(大于 20 分钟)
日期
全部
过去 24 小时
过去一周
过去一个月
去年
清晰度
全部
低于 360p
360p 或更高
480p 或更高
720p 或更高
1080p 或更高
源
全部
Dailymotion
Vimeo
Metacafe
Hulu
VEVO
Myspace
MTV
CBS
Fox
CNN
MSN
价格
全部
免费
付费
清除筛选条件
安全搜索:
中等
严格
中等(默认)
关闭
筛选器
2:59
YouTube
Chip Logic Studio
Verilog Day 1: Introduction and Data Types Explained from Scratch
Welcome to Day 1 of the Verilog Course by Chip Logic Studio (CLS)! In this video, we kickstart your Verilog HDL learning journey — from understanding what Verilog is, why it’s used in digital design and verification, and exploring all Verilog data types in detail. You’ll learn: 🔹 What is Verilog HDL and why it’s important in VLSI ...
已浏览 75 次
2 个月之前
Verilog Tutorial
How to Learn Verilog from Scratch?
substack.com
已浏览 1000 次
4 个月之前
9:27
Verilog Tutorial: Introduction to Verilog
YouTube
Beginners Point Shruti Jain
已浏览 15.6万 次
2017年8月14日
11:14
verilog tutorial for beginners getting started
YouTube
Wide Spectrum
已浏览 4880 次
2019年4月7日
热门视频
2:21
Verilog Day 1: Introduction and Data Types Explained from Scratch
YouTube
Chip Logic Studio
已浏览 1 次
1 个月前
2:12
Verilog Day 7: System Tasks Explained
YouTube
Chip Logic Studio
已浏览 15 次
1 周前
2:29
Verilog Day 7: System Tasks Explained
YouTube
Chip Logic Studio
已浏览 36 次
2 周前
Verilog Projects
2:59
Verilog Day 1: Introduction and Data Types Explained from Scratch
YouTube
Chip Logic Studio
已浏览 60 次
2 个月之前
2:58
Verilog Day 1: Introduction and Data Types Explained from Scratch
YouTube
Chip Logic Studio
已浏览 259 次
1 个月前
2:51
Blocking vs Non-Blocking in Verilog | Complete Guide with Examples
YouTube
Chip Logic Studio
已浏览 61 次
2 个月之前
2:21
Verilog Day 1: Introduction and Data Types Explained from Scratch
已浏览 1 次
1 个月前
YouTube
Chip Logic Studio
2:12
Verilog Day 7: System Tasks Explained
已浏览 15 次
1 周前
YouTube
Chip Logic Studio
2:29
Verilog Day 7: System Tasks Explained
已浏览 36 次
2 周前
YouTube
Chip Logic Studio
2:26
Understanding Procedural Blocks – initial, always, final
已浏览 144 次
1 个月前
YouTube
Chip Logic Studio
2:58
SystemVerilog vs Verilog in 60 Seconds! | Key Differences Explai
…
已浏览 584 次
4 个月之前
YouTube
Chip Logic Studio
2:12
Operators in Verilog HDL | Concatenation & Replication Tutor
…
已浏览 61 次
1 个月前
YouTube
Chip Logic Studio
2:54
Verilog Day 6: Testbench in Verilog
已浏览 72 次
3 周前
YouTube
Chip Logic Studio
2:51
Blocking vs Non-Blocking in Verilog | Complete Guide with Examples
已浏览 61 次
2 个月之前
YouTube
Chip Logic Studio
2:54
Verilog Day 5: Loops & Assign Block Explained
已浏览 95 次
1 个月前
YouTube
Chip Logic Studio
0:20
Verilog Code for Full Adder in Xilinx Vivado | Testbench & Simulation (
…
已浏览 1732 次
2 个月之前
YouTube
Sly Fox electronics
0:41
Asynchronous Active-Low Reset in Digital Circuits | Verilog RTL Expla
…
已浏览 386 次
1 个月前
YouTube
VLSI Simplified
3:00
Master Event Regions in Verilog/SystemVerilog – No More
…
已浏览 278 次
2 个月之前
YouTube
Chip Logic Studio
2:40
Build Your First SystemVerilog Testbench From Scratch
已浏览 86 次
2 个月之前
YouTube
Chip Logic Studio
0:13
Verilog Code for Half Adder in Xilinx Vivado | Testbench (Review)
已浏览 3529 次
2 个月之前
YouTube
Sly Fox electronics
1:13
⚖️ 2-Bit Comparator in Verilog + Testbench in 60 Seconds! | Digita
…
已浏览 228 次
5 个月之前
YouTube
Chip Logic Studio
0:29
Mastering VCS- A Step-by-Step Tutorial for Verilog Compiler Simu
…
已浏览 268 次
2024年5月23日
YouTube
VLSI Techno
1:09
SystemVerilog case vs casex vs casez
已浏览 171 次
5 个月之前
YouTube
Chip Logic Studio
0:19
Python on FPGA: Real-Time Verilog Demonstration! #shorts
已浏览 289 次
2 个月之前
YouTube
quantlabs
0:48
Verilog interview preparation || part 11 || #vlsi #verilog
已浏览 87 次
2 周前
YouTube
Fluxray Electronics
0:52
Verilog interview preparation || part 6 || #vlsi #verilog
已浏览 67 次
3 周前
YouTube
Fluxray Electronics
0:50
Verilog interview preparation || part 7 || #vlsi #verilog
已浏览 40 次
3 周前
YouTube
Fluxray Electronics
0:34
🎓 Top 10 Verilog Projects for BTech & MTech Students in VLSI🎓 #vlsidesi
…
已浏览 1581 次
11 个月之前
YouTube
ProV Logic
0:59
Systemverilog Interview questions 20/n #vlsi #education#shorts #des
…
已浏览 1880 次
2024年8月14日
YouTube
We_LSI
2:59
What is the difference between Analog and Real Modeling?
已浏览 3294 次
1 周前
YouTube
Cadence Design Systems
0:23
Verilog for Beginners: build basic logic gates on FPGA (with testben
…
已浏览 7577 次
7 个月之前
YouTube
Sly Fox electronics
What is the Difference Between Blocking and Non Blocking in Veri
…
已浏览 4158 次
8 个月之前
YouTube
Aditya Singh
1:00
Systemverilog Interview questions 23/n #vlsi #education#shorts #des
…
已浏览 2049 次
2024年8月24日
YouTube
We_LSI
1:00
Systemverilog Interview questions 18/n #vlsi #education#shorts #des
…
已浏览 2283 次
2024年7月23日
YouTube
We_LSI
0:55
Systemverilog Interview questions 22/n #vlsi #education#shorts #des
…
已浏览 2297 次
2024年8月16日
YouTube
We_LSI
3:00
Build Your First SystemVerilog Testbench From Scratch
已浏览 67 次
2 个月之前
YouTube
Chip Logic Studio
0:18
FPGA Tft Driver in Verilog: It Works! #digitallogic #electronicslab #diye
…
已浏览 1418 次
2 个月之前
YouTube
Furt Tech Industries
0:59
How to Write a Constraint to Generate a Right-Sided Triangle P
…
已浏览 2028 次
2024年6月2日
YouTube
PODCAST-with-NAVNEET
0:56
Systemverilog Interview questions 11/n #vlsi #education#shorts #des
…
已浏览 2066 次
2024年6月24日
YouTube
We_LSI
1:26
Who Creates Real Number Models? | Mixed-Signal RNM
已浏览 624 次
1 周前
YouTube
Cadence Design Systems
0:19
Spectrum analyser on FPGA | Fast Fourier Transform
已浏览 1545 次
3 个月之前
YouTube
The Hardware Developer
0:40
Functions vs Tasks in Verilog HDL
已浏览 1262 次
2 个月之前
YouTube
ProV Logic
2:59
Verilog Day 1: Introduction and Data Types Explained from Scratch
已浏览 60 次
2 个月之前
YouTube
Chip Logic Studio
3:00
Modern Digital Circuit Design with AI — No Code Needed!
已浏览 257 次
3 个月之前
YouTube
INKOR Technologies Private Limited
2:52
Understanding Procedural Blocks – initial, always, final
已浏览 133 次
1 个月前
YouTube
Chip Logic Studio
2:35
Verilog Code flip flop & latch Part 3
已浏览 146 次
4 个月之前
YouTube
Chip Logic Studio
1:03
Top 5 Verilog PROJECTS ..
已浏览 1696 次
11 个月之前
YouTube
VLSI Gold Chips
0:38
Task and Function in Verilog || How to Learn Verilog || Skills Required
…
已浏览 802 次
11 个月之前
YouTube
Aditya Singh
2:31
Master Event Regions in Verilog/SystemVerilog – No More
…
已浏览 32 次
2 个月之前
YouTube
Chip Logic Studio
1:00
Verilog Structural Design|System Verilog Structural Modeling |half a
…
已浏览 495 次
2024年10月11日
YouTube
Tech Spot with Harish Goupale
3:00
Operators in Verilog HDL | Concatenation & Replication Tutor
…
1 个月前
YouTube
Chip Logic Studio
0:44
Generate Verilog code from FSM or block diagram
已浏览 1110 次
10 个月之前
YouTube
Design with Manish
2:58
Verilog Day 1: Introduction and Data Types Explained from Scratch
已浏览 259 次
1 个月前
YouTube
Chip Logic Studio
2:21
Verilog Day 7: System Tasks Explained
1 周前
YouTube
Chip Logic Studio
0:44
Verilog interview preparation || part 10 || #vlsi #verilog
已浏览 48 次
2 周前
YouTube
Fluxray Electronics
0:58
Verilog interview preparation || part 8 || #vlsi #verilog
已浏览 27 次
3 周前
YouTube
Fluxray Electronics
1:22
🔧 Verilog MUX Design & Testbench in 60 Seconds! 💻 | Digital Design Basics
已浏览 215 次
5 个月之前
YouTube
Chip Logic Studio
1:00
verilog code for 2:1 Mux in behavioural modeling #verilog #rtl
…
已浏览 409 次
4 个月之前
YouTube
Explore VLSI
0:56
Verilog interview preparation || part 4 || #vlsi #verilog
已浏览 218 次
3 周前
YouTube
Fluxray Electronics
1:00
Understanding `timescale in Verilog| System Verilog `timescale | tech s
…
已浏览 307 次
2024年10月13日
YouTube
Tech Spot with Harish Goupale
2:07
Types of Modeling in Verilog Explained in 60 Seconds! 💡 #Verilo
…
已浏览 209 次
5 个月之前
YouTube
Chip Logic Studio
2:25
Understanding Procedural Blocks – initial, always, final
已浏览 182 次
1 个月前
YouTube
Chip Logic Studio
2:10
Verilog Day 5: Loops & Assign Block Explained
已浏览 32 次
4 周前
YouTube
Chip Logic Studio
2:59
Verilog Day 1: Introduction and Data Types Explained from Scratch
已浏览 30 次
1 个月前
YouTube
Chip Logic Studio
2:59
Verilog Day 5: Loops & Assign Block Explained
已浏览 118 次
1 个月前
YouTube
Chip Logic Studio
观看更多视频
更多类似内容
反馈